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DDRI/II 信號(hào)的品質(zhì)測(cè)試
DDRI/II 信號(hào)的品質(zhì)測(cè)試
作者:佚名  來源:不詳  錄入:Admin  更新時(shí)間：2008-8-4 4:59:34  點(diǎn)擊數(shù)：1
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    隨著DDR存儲(chǔ)技術(shù)的發(fā)展，工程師在工作中涉及到DDR的機(jī)會(huì)也越來越多，更多的公司，包括芯片設(shè)計(jì)、DIMM和系統(tǒng)廠商，正面臨著性能驗(yàn)證和測(cè)試的難題。除了產(chǎn)品互通性問題和信號(hào)品質(zhì)，工程師甚至還需要結(jié)合EDA設(shè)計(jì)軟件仿真分析電路信號(hào)完整性。

圖1，在金手指處測(cè)得的DQS/DQ 電壓波形

　　由于DDR自身信號(hào)的復(fù)雜性，包括差動(dòng)時(shí)脈信號(hào)，數(shù)十路Data Strobe（DQS）和Data（DQ）信號(hào)，每一路都有高阻（Hi-Z）和邏輯高（1）、低（0）三種狀態(tài)（Tri-State），再加上五六路控制信號(hào)，十幾路地址信號(hào)，使得其性能驗(yàn)證和測(cè)試變得極具挑戰(zhàn)性。本文將介紹如何透過安捷倫創(chuàng)新的示波器DDR測(cè)試軟件，確認(rèn)問題產(chǎn)生時(shí)對(duì)應(yīng)的具體時(shí)間/時(shí)序和信號(hào)品質(zhì)，和如何運(yùn)用安捷倫EEsof ADS先進(jìn)設(shè)計(jì)系統(tǒng)EDA，進(jìn)行電路設(shè)計(jì)和仿真。

圖2，(a) Hi-Z在眼圖中央               　　          (b),Hi-Z被去掉之后的眼圖

　　時(shí)序驗(yàn)證是DDR量測(cè)的關(guān)鍵之一，也是最困難的部分。在面對(duì)高速總線時(shí)，眼圖是最常用的信號(hào)完整性測(cè)試方法，但由于DDR信號(hào)本身的獨(dú)特性，傳統(tǒng)的『觸發(fā)-堆棧』方式不適用于DDR，導(dǎo)致很多工程師都已經(jīng)放棄這樣的測(cè)試方式。

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