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以太網(wǎng)到多路E1適配電路設計及FPGA實現(xiàn)
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 更新時間:2008-8-17 16:16:43  點擊數(shù):24
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2 4.85 4.33 4.06 4.00 3.98 3.93 3.93
3 7.25 6.41 6.09 5.93 5.75 5.75 5.75
4 9.57 8.57 8.06 7.97 7.83 7.80 7.80
5 11.88 10.76 10.25 9.88 9.75 9.75 9.75
6 14.47 12.72 12.06 11.75 11.74 11.43 11.43
7 16.82 15.07 14.25 13.87 13.50 13.50 13.50
8 19.27 17.26 16.13 15.75 15.37 15.37 15.37

表2 以太網(wǎng)口傳輸時延(單位μs)

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