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利用 CPLD 降低處理器功耗
利用 CPLD 降低處理器功耗
 更新時間:2008-8-3 15:44:39  點擊數(shù):30
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i-font-family: " Roman?; New Times mso-ansi-language: 宋體; mso-bidi-font-family: ZH-CN?>到 1W。微處理器的操作模式包括正常、運行、睡眠、掛起、待機、停止和空閑等,因器件和制造商而異。各操作模式之間的功耗變化范圍可達 230mW。某些低功耗微處理器在正常操作模式下的功耗可少至 250mW。 

 

示例 

    注所提供的微處理器參考僅為示例,用來說明不同操作模式下的功耗。鑒于尚無確定功耗的標(biāo)準(zhǔn)方法,本文檔中的數(shù)據(jù)以制造商提供的數(shù)據(jù)為依據(jù),僅供參考。有關(guān)詳情,請見“參考文獻”。 

    下面舉例說明微處理器在不同操作模式下的功耗差異。圖 2 所示為 Intel StrongARM SA-1110 微處理器在不同操作模式下的功耗。圖 2 所示功耗數(shù)字的確定條件是:工作頻率 206 MHz,標(biāo)稱外部供電電壓 3.3 V,內(nèi)部供電電壓 1.8 V。 

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